이득 및 위상 변이는 회로가 정현파 입력 전압 또는 전류에 미치는 영향을 설명하는 선형 회로의 속성입니다. 반응 요소를 포함하는 회로의 동작은 입력 정현파의 주파수에 따라 달라집니다. 결과적으로 이득과 위상 변이는 모두 주파수 함수가 되는 것으로 관찰됩니다.
얻다:
V_in이 회로의 입력이고 V_out이 출력 신호라고 가정합니다.
입력 및 출력 신호는 각각 진폭 A 및 B와 위상각 0° 및 θ°를 갖습니다.
회로의 이득은 입력 정현파와 출력 정현파의 크기 사이의 관계를 제공합니다. 특히 이득(K)은 입력 정현파 진폭에 대한 출력 정현파 진폭의 비율입니다.
이득 K가 1보다 크면 증폭을 의미하고 이득 K가 1보다 작으면 감쇠를 나타냅니다. 이득은 로그 눈금을 사용하여 설명됩니다. 데시벨(dB)로 표시할 때 게인은 동일한 규모에서 매우 큰 숫자와 매우 작은 숫자를 나타내는 편리한 방법을 제공합니다. 데시벨 단위의 이득은 다음 공식을 사용하여 계산됩니다.
어디:
dB는 데시벨 단위의 이득입니다.
K는 이득이고,
log는 밑이 10인 로그입니다.
위상 변화:
위상 변이는 입력 신호의 위상에 비해 출력 신호의 위상이 지연되거나 진행되는 정도를 나타냅니다. 이는 출력 정현파와 입력 정현파 사이의 각도 차이입니다. 입력 및 출력 신호의 위상각은 각각 0°와 θ°이며, 위상 변이(θ_shift)는 다음과 같이 계산됩니다.
양의 θ_shift는 출력 신호가 입력 신호보다 뒤처져 있음을 나타내고, 음의 θ_shift는 출력 신호가 입력 신호보다 앞서 있음을 의미합니다.
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