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14.3 : 수학, 그래픽 및 이산 신호

모든 LTI(선형 시불변) 시스템에서 두 신호의 합성은 모든 초기 조건이 0이라고 가정하고 합성 연산자를 사용하여 표시합니다. 합성 적분은 두 부분으로 나눌 수 있습니다. 0 입력 또는 자연 응답과 0 상태 또는 강제 응답이며, t_0은 초기 시간을 나타냅니다.

합성 적분을 단순화하기 위해 입력 신호와 임펄스 응답이 모두 음의 시간 값에 대해 0이라고 가정합니다. 그래픽 합성 프로세스에는 폴딩, 이동, 곱셈 및 적분의 네 단계가 포함됩니다.

지정된 입력 펄스 신호와 출력 응답이 있는 RC 회로를 고려합니다. 처음에는 y축을 따라 입력 신호의 거울 이미지를 만들어서 폴딩을 수행합니다. 그 다음에 이동을 수행하여 폴딩 신호를 시간 축을 따라 슬라이드합니다. 다음으로, 폴딩 및 이동된 신호를 점별로 곱합니다. 마지막으로 결과 신호를 시간에 따라 적분하여 합성 결과를 제공합니다. 이 과정은 그래픽으로 표현할 수 있습니다.

이산 시간 합성에서 시스템의 응답은 이산 시간 시스템에 입력을 적용하고 임펄스 응답과 합성 합을 사용하여 결정됩니다. 이산 입력 신호 x[n]와 임펄스 응답 h[n]의 합성은 시스템 응답에 대한 합성 합을 형성합니다.

Equation1

이 합은 각 이산 시간 단계 n에서 출력 신호 y[n]를 계산합니다. 연속 합성과 이산 합성을 모두 이해하는 것은 LTI 시스템을 분석하고 다양한 입력에 대한 응답으로 동작을 예측하는 데 필수적입니다.

Tags

ConvolutionLTI SystemConvolution OperatorConvolution IntegralZero input ResponseZero state ResponseImpulse ResponseRC CircuitFoldingShiftingMultiplicationIntegrationDiscrete time ConvolutionConvolution SumOutput Signal

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